如果是LED的电子钟我来简单的说下吧，就是个数字电路,先用晶振分频得到个1HZ的频率，再用数字IC记录下来,改成6进制和12进制,再用译码器变成7段BCD码通过数码管显示出来,比如用晶振32768+CD4060分频就能得到1HZ的时钟频率,再用CD4518改成6进制且编译成BCD码,然后用CD4514B驱动7段LDE数码管就能显示出来了,如果会单片机就更简单了,可以全集成在里面，只是单片机以扫描方式驱动，省出来很多脚位。总结来说，LED电子钟就是个1HZ的记录器,1秒1秒的加上去,只不过记录方式是6进制和12或24进制而已
数字钟的工作原理
设计数字时钟计数器电路大概有以下几种方法：
①用标准的数字集成电路家族来搭建十进制计数器。常用的TTL数字电路家族为7400系列。常用的CMOS数字电路家族为CD4000系列。
②用基本的组合逻辑电路和触发器来实现。利用数字设计中的状态图/卡诺图等综合工具从底层门电路来搭建。
③用硬件设计语言来实现。常见的数字设计语言为VHDL和Verilog
本文就以JK触发器和附加门电路来演示如何设计一个七进制加法计数器时钟电路。
总体步骤为：
①画出计数器的状态转换图。
②根据状态图得出JK各个状态变量的逻辑值。
③将JK的逻辑状态代入卡诺图进行化简，得出JK表达式。
④根据JK表达式，画出计数器的原理图。
⑤仿真验证计数器的输出。
以下为详细分解：
①②步骤比较直观状态图如下。计数器需要3个JK触发器，标记为JK1/JK2/JK3
步骤③卡诺图化简以J2为例，其他的值类似，J2的卡诺图为：
也即J2=BC=Q1Q0，所以简单的与门即可实现。
步骤④的电路原理图为：
步骤⑤的仿真验证计数器的输出为：（LED输出0～6并重复）
数字钟的原理是什么？
单片机通过了 3只 74HC164串行－并行转换芯片后，驱动时钟屏幕，因为时钟屏幕的极性是共阴极，
所以必须使用“74HC”电路而不能使用“74LS”电路，后者的高电平驱动能力很差！这里的 3 只 74HC164芯片，自身属于串行输入，而从单片机一则看过去，3 只芯片驱动方式则是并行驱动，这样可以避免每次传送新的显示数据时，都需要从头到尾传送 24 个笔段数据。目前的传送方式可以只是传送已经变化了的显示数据。晶体频率使用的是 32768HZ，这种低频率时基，对掉电保护的电池耗电关系极大，HT48R10A单片机具有的“RTC”实时时钟的功能，大大方便了电路设计。
按照常规，在如此低的频率下，对单片机的指令执行速度会有矛盾，但是，这种单片机却能够让程序运行时使用“内部 RC ”振荡频率而仅仅是时钟部分使用 32768HZ频率，这样，就可以选择“内部 RC”高达数 MHZ 的指令运行频率而不用理会时钟走时频率，两者依靠这种特有的“RTC”功能获得了很理想的配合。当进入电池掉电保护的时候，可以令电池耗电维持在仅仅数十 uA 的水平，一只 60mAh的掉电保护电池，就可以让掉电保护时间长达几个月之久！进入掉电保护后，屏幕不显示，所有按钮和控制功能暂时失效，仅仅实时时钟仍然继续走时。当外部主电源恢复供电后，所有功能自动恢复，实时时钟无需调整。单片机的 15P是复位引脚，当上电时或者程序运行发生异常时，可以通过此引脚让程序重新运行。
但是，一般地，单片机本身具有“看门狗”自动复位功能，可以快速地自动对程序运行异常进行复位，人们几乎觉察不到它的复位影响。单片机的 10P 引脚安排为专门检测外部供电是否正常，当外部 5V供电掉电后，单片机将立即进入掉电保护状态，而在电路中电源能量还没有完全消耗尽之前，程序也必须抢先对各个端口进行配置，以便进入低电源消耗状态。电路图中有两个输出端口，一个是“睡眠”控制输出端口，它只有在开始倒计时的时候才会输出高电平；另一个时“定时”输出端口，它只有在到达定时时间的时候才会输出高电平。
合理地利用这两个输出，就能够安排一些简单的自动控制，例如，可以利用“睡眠”的倒计时功能来给电孵化行业的“自动翻蛋”使用，利用“定时”功能来作为一只“电子闹钟”等等。电路中，屏幕的公共引脚接有一只 NPN小功率三极管，这主要是在单片机对 74HC164 传送数据时，临时关闭显示屏幕的供电以免产生“鬼影”，同时，在掉电保护时则可以完全关闭屏幕的供电。单片机预留了两个端口没有使用，这里可以在将来安排外接电存储器，以便派生例如电子打铃仪或者多次定时数据存储，成为功能更加丰富的时钟品种。各个按钮的使用说明：(请参考印刷板图)。各按键在印刷板上的编号与单片机芯片引脚和功能关系，请参考下面表格。其中，标注“G”的焊盘是电路供电的参考点，即 5V电源的负极，俗称“地线”。所有按键都是需要与这个“G”接通的时候（需要串入 1K 左右电阻），该按键才算是“被按下”。当这个“G”引出到按键板时，需要在它上面串接一只 1K左右的电阻，不要直接让其与各按键引脚直接“短接”，以防止芯片内部引脚损坏。
是以一种元器件做为振动源，而这种振动源在一定条件下，具有很高的恒定频率，把恒频率的振动转化为电脉冲，再按1秒多少次，用电子器件进行计数，达到次数为1秒，计数60秒为1分钟，并用相应的显示机构进行显示，这种机构可以是机械的、也可以是电子液晶、二极管等方式。
数字钟电路是一个典型的数字电路系统,其由时,分,秒计数器以及校时和显示电路组成下面介绍利用集成十进制递增计数器(74160)和带译码器的七段显示数码管组成的数字钟电路计数器74160和七段显示数码管的功能及使用方法在84节已有叙述
1 利用两片74160组成60进制递增计数器
利用两片74160组成的同步60进制递增计数器如图94-1所示，其中个位计数器（C1）接成十进制形式。十位计数器（C2）选择QC与QB做反馈端，经与非门输出控制清零端（CLR’），接成六进制计数形式。个位与十位计数器之间采用同步级连方式，将个位计数器的进位输出控制端（RCO）接至十位计数器容许端（ENT），完成个位对十位计数器的进位控制。将个位计数器的RCO端和十位计数器的QC、QA端经与们由CO端输出，作进位输出控制信号。当计数器状态为59时，CO端输出高电平，在同步级联方式下，容许高位计数器计数。选择信号源库中的1HZ方波信号作为计数器的测试时钟源。
因为秒与分计数均由60进制递增计数器来完成，为在构成数字钟系统时使电路得到简化，我们将图94-1虚线框内建立部分用子电路表示。具体操作过程如下：
在EWB主界面内建立图94-1所示60进制计数器，闭合仿真电源，经过功能测试，确保计数器工作正常。选中虚线框内所示部分电路（Circuit）菜单中的创建子电路（Creat Subcircuit……）项，主界面内出现子电路设置对话框，在对话框内添入电路名称（60C）后，选择在电路中置换（Replace in Circuit）项，得用子电路表示的60进制递增计数器如图94-3所示。
2、用两片74160组成24/12进制递增计数器
图94-4所示电路是由两片74160组成的能实现12和24进制转换的同步递增计数器。图中个位与十位计数器均接成十进制计数形式，采用同步级连方式。选择十位计数器的输出端QB和个位计数器的输出端QC通过与非门NAND2控制两片计数器的清零端（CLR’），利用状态24反馈清零，可实现24进制递增计数。若选择十位计数器的输出端QA与个位计数器的输出端QB经过与非门NAND1输出，控制两片计数器的清零端（CLR’），利用状态12反馈清零，可实现12进制递增计数。敲击Q键，使开关K选择与非门NAND2输出或NAND1输出可实现24和12进制递增计数器的转换。该计数器可利用作数字钟的时计数器。
为简化数字钟电路，我们将图94-4所示的24/12进制计数器虚线框内电路转换为子电路，转换方法与上述60进制计数器相同。用子电路表的24/12进制同步计数器如图94-5所示。
3 数字钟系统的组成
利用60进制和24/12进制递增计数器子电路构成的数字钟系统如图94-6所示。在数字钟电路中，由两个60进制同步递增计数器完成秒、分计数，由24/12进制同步递增计数器实现小时计数。
秒、分、时计数器之间采用同步级连方式。开关K控制小时的24进制和12进制计数方式选择。为简化电路，直接选用信号源库中的方波秒脉冲作数字钟的秒脉冲信号，读者可自行设计独立的秒脉冲源，例如；可利用555多谐振荡器产生的秒脉冲，或者采用石英晶体振荡器经分频器产生秒脉冲。还可以在小时显示的基础上，增加上、下午或日期显示以及整点报时等，这里不再赘述。
敲击S和F键，可控制开关S和F 将秒脉冲直接引入时、分计数器，实现校时。
对于图94-6所示数字钟电路，若要进一步 简化电路还可以利用子电路嵌套功能将虚线框内电路转换为更高一级的子电路，我们将子电路命名为CLOCK，用高一级子电路表示的数字钟电路如图94-7所示。
今后在设计用到数字钟作单元电路的系统时可直接引用该电路，使系统得到简化。
图1、数字电子钟结构图
2、秒钟、分钟计时电路的设计
利用集成十进制递增计数器（74160）和带主译码器的七段显示数码管组成的数字钟电路。计数器74160的功能真值表如图2所示。
根据计数器74160的功能表真值表，利用两片74160组成的同步六十进制递增计数器如图3示，其中个位计数器（CL）接成十进制形式。十位计数器（C2）选择QC与QB做反馈端，经与非门（NEND）输出控制清零端（CLR），接成六进制计数形式。个位与十位计数器之间采用同步级连复位方式，将个位计数器的进位输出控制端（RCO）接至十位计数器的计数计数器的计数容许端（ENT），完成个位对十位计数器的进位控制QC，QA端经过与门AND1和AND2由CO端输出，作为六十进制的进位输出脉冲信号，
图二、同步十进制计数器74160真值表
当计数器计数状态为59时，CO端输出高电平，在同步级联方式下，容许高位计数器计数。电路创建完成后，进行仿真实验时，利用信号源库中的1HZ方波信号作为计数器的时钟脉冲源。
图3、秒钟/分钟计时电路
因为秒钟与分钟技术均由六十进制递增计数器来完成，为在构成数字钟系统时使电路得到简化，图虚线框内的电路创建为子电路表示。具体操作过程如下：在EWB主界面内建立如示的六十进制计数器，闭合仿真电源开关，经过计数器功能测试，确定计数器工作正常，选中虚线框内所示部分电路后，再选择电路菜单中创建子电路框内添入子电路名称（分计时）后，选择在电路中置换选项，得到用子电路表示的六十进制递增计数器，即秒钟/分钟计时子电路，如图4
图4、分钟计时子电路对话框
图5、分钟计时电路
四、24/12进制的能实现递增计数器
24/12进制的能实现十二四进制的同步递增计数器。如图四。所示。图中个位与十位计数器均接成十进制计数形式，采用同步级联复位方试。 选择十位计数器的输出端Qb和个位计数器 输出端Qc通过与非门NAND2的控制两片计数器的清零端CLR，当计数器的输出状态为00100100时，立即译码清零，实现二进制纟递增计数器：若选择十位二进制的输出端Q a与个位计数器的输出端Qb经与非门NAD1控制两片计数器的清零端CLR，当计数器的输出状态为00100100时，立即译码反馈为零，实现二十进制递增计数器，若选择十位计数器的输出端Qb经与门NAND1控制两片计数器的清零端CLR。当计数器的输出端状态为00010010时，立即译码反馈为零，实现十二进制递增计数，敲Q，开关Q 选择与非门NAND2输出和NA民NAND1输出实现二十四进制递增计数器的转换。计数器用作数子钟的计数器。
图6、24/12二进制计时电路
为了简化数子电子钟的电路，需要将图765的24/12二进制计数器的线框内电路转换为子电路，方法与上面六二进制的分计数器一样，用子电路表示24/12进同步计数器如图7。
图7、24/12计时电路
五、数字电子钟系统的组成
利用六十进制和24/12进制递增计数器子电路构成的数字电子钟系统如图8所示，在数字电子钟电路中，由两个六十进制同步递增计数器分别构成秒钟计时器和分计时器，级连够完成秒 ，分计时、由24/12进制同步递增计实现小时计数。秒、分、时计数器之间采用同步级连方式，开关（Q）控制小时的二十四进制和十二进制计数方式选择，敲击S和F键，可控制开关S和F将秒脉冲直接引入时，分计数器，实现时计数器和分计数器的校时。
对于图所示数字电子钟电路，为了进一步简化电路，还可以利用子电路嵌套功能，将虚线框内电路转换为更高一级的子电路，成为子电路数字电子钟，用嵌套子电路表示的数字电子钟电路如图8所示
图8、24/12进制计数电路
以上创建的各种子电路都已经存入自定义元器件库中，在其他电子系统设计中需要时，可以直接调用这些子电路，使系统的设计更方便，更快捷。
访真实验时，可直接选用信号源库中的方波秒脉冲作数字钟的秒脉冲信号，作为一个设计内容，读者可自行设计独立的秒脉冲信号源，可利用555定时器组成多谐震荡器产生秒钟脉冲信号，或者采用石英晶体震荡器经分频器产生秒脉冲，脉冲频率更稳定，计时误差会更小，还可以在小时显示的基础上，增加上下午或日期显示，整点报时电路以及作息时间提示电路等。
